MathWorks、MATLAB等からHDLコードを生成/検証できる製品を発表

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MathWorks、MATLAB等からHDLコードを生成/検証できる製品を発表


掲載日:2012/03/06


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 MathWorksは、MATLAB(技術計算のための言語)からHDLコードを自動生成でき、FPGA/ASIC設計を実装できる「HDL Coder」と、FPGA/ASIC設計をテストするためのFPGAハードウェアインザループ機能を備えた「HDL Verifier」を発表した。既に入手可能で、価格はそれぞれ135万円から、42万5000円から。

 両製品を利用することで、MATLABとSimulinkでのHDLコードの生成と検証が可能になる。

 「HDL Coder」では、移植と合成が可能なVHDLコードとVerilogコードが、MATLAB関数とSimulinkモデルから生成され、FPGAのプログラミングやASICのプロトタイピングと設計に使用できる。これにより、ハードウェア実装に適したアルゴリズムを短時間で特定できるようになる。また、Simulinkモデルと、生成したHDLコードとの間のトレーサビリティによって、DO-254などの標準規格に準拠する高信頼性アプリケーションの開発がサポートされている。

 「HDL Verifier」では、AlteraやXilinxのFPGAボード向けに、FPGAハードウェアインザループ検証が新しくサポートされた。MATLABとSimulinkをCadence製Incisive、Mentor Graphics製ModelSim、Questa HDLの各シミューレータと接続する協調シミュレーション インターフェースが用意されている。これらの機能を活用することで、エンジニアはHDL実装がMATLABアルゴリズムやSimulinkシステム仕様と一致しているかを短時間で検証できる。


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